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学生职业成果

12%

加薪或升职
可分享的证书
完成后获得证书
100% 在线
立即开始,按照自己的计划学习。
第 1 门课程(共 4 门)
可灵活调整截止日期
根据您的日程表重置截止日期。
中级
完成时间大约为18 小时
英语(English)

您将获得的技能

Primality TestVerilogDigital DesignStatic Timing Analysis

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第 1 门课程(共 4 门)
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中级
完成时间大约为18 小时
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提供方

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科罗拉多大学波德分校

立即开始攻读硕士学位

此 课程 隶属于 科罗拉多大学波德分校 提供的 100% 在线 Master of Science in Electrical Engineering。 如果您被录取参加全部课程,您的课程将计入您的学位学习进程。

教学大纲 - 您将从这门课程中学到什么

内容评分Thumbs Up93%(3,111 个评分)Info
1

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完成时间为 4 小时

What's this programmable logic stuff anyway? History and Architecture

完成时间为 4 小时
9 个视频 (总计 46 分钟), 4 个阅读材料, 2 个测验
9 个视频
Course Overview6分钟
1. Welcome to the world of programmable logic and FPGA design1分钟
2. A Brief History of Programmable Logic9分钟
3. CPLD Architecture5分钟
4. LUTs and FPGA Architecture8分钟
5. LUTs for Logic Design2分钟
6. Designing Adders6分钟
7. Designing Multipliers3分钟
4 个阅读材料
About This Course10分钟
Hardware Requirements10分钟
Week 1 Suggested Readings1 小时 20 分
Week 2 Assignment Instructions and Files10分钟
1 个练习
Mission 002: Week 1 Quiz30分钟
2

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完成时间为 4 小时

FPGA Design Tool Flow; An Example Design

完成时间为 4 小时
11 个视频 (总计 121 分钟), 1 个阅读材料, 3 个测验
11 个视频
2. Downloading Quartus Prime2分钟
3. Installing Quartus Prime2分钟
4. Introducing Quartus Prime11分钟
5. Create a design project in Quartus Prime7分钟
6. Create a design in Quartus Prime13分钟
7. Compile a Design17分钟
8. View the RTL16分钟
9. Timing Analysis with Time Quest I9分钟
10. Timing Analysis with Time Quest II16分钟
11. Simulate a design with ModelSim17分钟
1 个阅读材料
Week 2 Suggested Readings20分钟
2 个练习
Mission 003 : Practice Opportunity30分钟
Mission 005: Week 2 Quiz30分钟
3

3

完成时间为 4 小时

FPGA Architectures: SRAM, FLASH, and Anti-fuse

完成时间为 4 小时
8 个视频 (总计 80 分钟), 2 个阅读材料, 1 个测验
8 个视频
2. Xilinx CPLD Architecture7分钟
3. Xilinx Small FPGAs8分钟
4. Xilinx Large FPGAs11分钟
5. Altera CPLDs and Small FPGAs8分钟
6. Altera Large FPGAs9分钟
7. Microsemi Single-chip FPGA solutions14分钟
8. Lattice Single-Chip FPGA solutions14分钟
2 个阅读材料
Week 3 Suggested Readings1 小时 20 分
Week 4 Assignment Instructions and Files10分钟
1 个练习
Mission 006: Week 3 Quiz30分钟
4

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完成时间为 6 小时

Programmable logic design using schematic entry design tools

完成时间为 6 小时
10 个视频 (总计 180 分钟), 1 个阅读材料, 2 个测验
10 个视频
2. Advanced Schematic Entry for FPGA Design- Drawing and Hierarchy26分钟
3. Improving Productivity with IP Blocks25分钟
4. Improving Timing with Pipelining18分钟
5. FPGA IO: Getting In and Getting Out8分钟
6. Pin Assignments: Making them Spot On!20分钟
7. Programming the FPGA10分钟
8. Becoming one with Q: Qsys System Design20分钟
9.a Becoming one with Q Part II: Qsys System Design Finishing Touches25分钟
9.b Becoming one with Q Part III: Qsys System Design Finishing Touches19分钟
1 个阅读材料
Week 4 Suggested Readings1 小时 10 分
1 个练习
Mission 008: Week 4 Quiz30分钟

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